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( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	CC	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	CC	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	8	0	20	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	8	0	20	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	8	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	DD	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	A	F	20	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	A	F	20	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	A	F	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	DD	x


( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	8	0	20	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	8	0	20	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	8	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	DD	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	B	F	36	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	B	F	36	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	B	F	22	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	22	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	2	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	1	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	1	0	0	0	0	xx	|	x	1	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	1	0	0	0	0	xx	|	x	1	F136	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	1	F136	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	1	F936	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x


( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	B	F	C8	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	B	F	C8	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	B	F	22	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	22	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	2	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	1	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	1	0	0	0	0	xx	|	x	1	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	1	0	0	0	0	xx	|	x	1	F1C8	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	1	F1C8	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	1	F9C8	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x



( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	E	F	33	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	E	F	33	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	E	F	22	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	22	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	1	0	x	xx	x

( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --A 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x --B 
( 0 0 0 1 1 0 )	0	0	0000	0	0	0	0	0	0	xx	|	x	0	xxxx	0	0	0	0	0	0	x	xx	x




.

H�SmallCacheInner-PAll.oracle
Pradeep Sindhu May 11, 1988 5:18:43 pm PDT
Oracle File modified to work at top level (SmallCacheInner). Test completed April 23, 1988 12:38:17 pm PDT. This test now runs with the following settings:
Array		OutputSection
TLevel	TLevel
TLevel	Behav
Behav	TLevel
Behav	Behav

NB: Each line corresponds to one cycle of the DynaBus clock

The state of the cache following Reset is: all x's except for signals set otherwise by the hardware
_ Logic.SetOracleFileName["SmallCacheInnerTest", "SmallCacheInner-PAll"]

Perform the reset sequence:
Assert Reset till x's get flushed out (the last signal appears to be RamForP, which settles 3 cycles after BCtlRamForBCWS6, which settles in cycle 6):

  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														

Check that chip Id can be read out (scan path 0):
  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														

Shift In MyId (scan path 1) (Recall that MyId is only one bit so only one bit needs to be shifted in):
  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														

SmallCacheInner-InitialReads:
First Write the AID register:
 	D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
   S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
 	h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
 	i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
 	f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
 	t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
 	C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
 	k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
 	          n											I			|		O			t	u					d	   u
																n			|		u				t					e	   l
																			|		t											e
																			|														
Write AID [09], Kernel Mode:

Read it back to check it [09]:


Now do PReads to fill the cache:

  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														

PReadMiss-MapMiss-NoVictim[50]:
Let the grant come here, so we send our MapRqst
Here's our map request on our input wires, followed immediately by the MapRply
  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														
Give the grant for the RBRqst
Here's our RBRqst on our input wires
And shortly thereafter the RBRply


PReadMiss-MapHit-NoVictim[59]:
Give the grant for the RBRqst
Here's our RBRqst on our input wires
And shortly thereafter the RBRply

  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														
PReadMiss-MapMiss-NoVictim[8A]:
Let the grant come here, so we send our MapRqst
Here's our map request on our input wires, followed immediately by the MapRply
  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														
Give the grant for the RBRqst
Here's our RBRqst on our input wires
And shortly thereafter the RBRply
PReadMiss-MapHit-NoVictim[AB]:
Give the grant for the RBRqst
Here's our RBRqst on our input wires
And shortly thereafter the RBRply
  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														
PReadMiss-MapMiss-NoVictim[CC]:
Let the grant come here, so we send our MapRqst
Here's our map request on our input wires, followed immediately by the MapRply
  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														
Give the grant for the RBRqst
Here's our RBRqst on our input wires
And shortly thereafter the RBRply

PReadMiss-MapHit-NoVictim[D5]:
Give the grant for the RBRqst
Here's our RBRqst on our input wires
And shortly thereafter the RBRply

  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														
PReadMiss-MapMiss-NoVictim[26]:
Let the grant come here, so we send our MapRqst
Here's our map request on our input wires, followed immediately by the MapRply
  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														
Give the grant for the RBRqst
Here's our RBRqst on our input wires
And shortly thereafter the RBRply

PReadMiss-MapHit-NoVictim[3F]:
Give the grant for the RBRqst
Here's our RBRqst on our input wires
And shortly thereafter the RBRply

  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														

Now read one word from each of the lines 7, 6, 5, 4, 3, 2, 1, and 0
PReadHit[52]:
PReadHit[58]:
PReadHit[8F]:
PReadHit[AF]:
PReadHit[CC]:
PReadHit[D7]:
PReadHit[25]:
PReadHit[39]:
We add the following cycles to let the victim reach a stable value
The state of the cache at this point should be: SmallCacheArrayStateValues.cacheStateValueA
SmallCacheInner-Writes:
Do Word writes to each of the lines
PWriteHit[52] (line 7):
PWriteHit[58] (line 6):
PWriteHit[8F] (line 5):
PWriteHit[AF] (line 4):
PWriteHit[CC] (line 3):
PWriteHit[D7] (line 2):
PWrite-NoWritePermission[25] (line 1):

PWrite-NoWritePermission[39] (line 0):


Then read them back to verify the contents
PReadHit[52]:
PReadHit[58]:
PReadHit[8F]:
PReadHit[AF]:
PReadHit[CC]:
PReadHit[D7]:
PReadHit[25]:
PReadHit[39]:


Do Byte writes to each of the lines (write FF to word and then clear one or more bytes); for one of the byte writes make sure that the byte data has zeros in only the bytes were trying to write to ensure we weren't just lucky.
PWriteHit[52]:
PWriteHit[52]:
PWriteHit[58]:
PWriteHit[58]:
PWriteHit[8F]:
PWriteHit[8F]:
PWriteHit[AF]:
PWriteHit[AF]:
PWriteHit[CC]:
PWriteHit[CC]:
PWriteHit[D7]:
PWriteHit[D7]:

Read the words back to verify the contents
PReadHit[52]:
PReadHit[58]:
PReadHit[8F]:
PReadHit[AF]:
PReadHit[CC]:
PReadHit[D7]:
PReadHit[25]:
PReadHit[39]:
Add cycles to let the victim stabilize:

The victim should now be pointing to line 1. Next, reference line 1 to push victim to line 0:
PReadHit[25]:
The state of the cache at this point should be: SmallCacheArrayStateValues.cacheStateValueB

SmallCacheInner-WriteMisses:
Do a write miss
PWriteMiss-MapHit-NoVictim(78)
  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														
Give the grant for the RBRqst
Here is the RBRqst on our wires
Let the RBRply come here
Now read the word just written, and the other words from the block fetched
PReadHit[78]:
PReadHit[79]:
PReadHit[7A]:
PReadHit[7B]:
PReadHit[7C]:
PReadHit[7D]:
PReadHit[7E]:
PReadHit[FF]:

Do another write miss
PWriteMiss-MapHit-Victim(40)
  D D D n n D	  D	B	B		G	G	I	P	P	P	P		|	D	H	B		B	B	R	S	P	P	P	P  P
  S A E D D S	  S	C	D		L	r	S	m	C	B	D		|	B	d	D		O	S	e	S	R	F	F	D  R
  h d x F R e	  e	y	a		e	a	S	o	m	y	a		|	u	r	a		w	h	q	t	e	a	a	a  e
  i d e r e r	  l	c	t		n	n	t	d	d	t	t		|	s	C	t		n	a	u	o	j	u	u	t  s
  f r c e s i	  e	l	a		g	t	o	e	I	e	a		|	O	y	a		e	r	e	p	e	l	l	a  c
  t e u e e a	  c	e	I		t		p	I	n	S			|	u	c	O		r	e	s	O	c	t	t	   h
  C s t z t l	  t	0	n		h		I	n		e			|	t	l	u		O	d	t	u	t		C	   e
  k s e e   I	 							n			l			|		e	t		u	O		t			o	   d
            n											I			|		O			t	u					d	   u
															n			|		u				t					e	   l
																		|		t											e
																		|														
Give the grant for the FlushBlock and then immediately after that for the RBRqst
Let the FBRply come here
And soon after the RBRply
Now read the word just written, and the other words from the block fetched
PReadHit[40]:
PReadHit[41]:
PReadHit[42]:
PReadHit[43]:
PReadHit[44]:
PReadHit[45]:
PReadHit[46]:
PReadHit[47]:
SmallCacheInner-IO:
Check the operation of each IO location in turn:
CWSOld:
Write CWSOld [01], Kernel Mode:
Read it back [01]:
Write CWSOld [01], User Mode:
Read it back [01]:
Write CWSOld [01], User Mode, ByteWrite:
Read it back [01]:
CWSNew:
Write CWSOld [03], Kernel Mode:
Read it back [03]:
Write CWSOld [03], User Mode:
Read it back [03]:
Write CWSOld [03], User Mode, ByteWrite:
Read it back [03]:
AID:
Write AID [09], Kernel Mode:
Read it back [09]:
Write AID [09], ByteWrite:
Read it back [09]:

Write AID [09], User Mode: Should generate protection fault
FaultCode:
Write FaultCode [0B], Kernel Mode:
Read it back [0B]:
Write FaultCode [0B], ByteWrite:
Read it back [0B]:

Write FaultCode [0B], User Mode: Should generate protection fault
InterruptStatus:
Write InterruptStatus [0D], Kernel Mode:
Read it back [0D]:
Write InterruptStatus [0D], ByteWrite:
Read it back [0D]:

Write InterruptStatus [0D], User Mode: Should generate protection fault
InterruptMask:
Write InterruptMask [0F], Kernel Mode:
Read it back [0F]:
Write InterruptMask [0F], ByteWrite:
Read it back [0F]:

Write InterruptMask [0F], User Mode: Should generate protection fault

Write 00 to InterruptMask [0F], Kernel Mode:
Read it back to check:

Write AA to InterruptMask [0F], Kernel Mode:
Read it back to check:

Write 00 to InterruptStatus [0D], Kernel Mode:
Read it back to check:
Starting at the highest order bit, set and then clear each bit, checking that SetReschedule is correctly generated. Since we wrote 1010 1010 (AA) into InterruptMask, we should get the alternating pattern 1010 1010 for SetReschedule.

Set bit 0:
Check that bit 0 got set:
Clear bit 0:
Check that bit 0 got cleared:
Set bit 1:
Check that bit 1 got set:
Clear bit 1:
Check that bit 1 got cleared:
Set bit 2:
Check that bit 2 got set:
Clear bit 2:
Check that bit 2 got cleared:
Set bit 3:
Check that bit 3 got set:
Clear bit 3:
Check that bit 3 got cleared:
Set bit 4:
Check that bit 4 got set:
Clear bit 4:
Check that bit 4 got cleared:
Set bit 5:
Check that bit 5 got set:
Clear bit 5:
Check that bit 5 got cleared:
Set bit 6:
Check that bit 6 got set:
Clear bit 6:
Check that bit 6 got cleared:
Set bit 7:
Check that bit 7 got set:
Clear bit 7:
Check that bit 7 got cleared:
Modes:
Write Modes [25], Kernel Mode:
Read it back [25]:
Write Modes [25], ByteWrite:
Read it back [25]:

Write Modes [25], User Mode: Should generate protection fault
LocalFaultCode:
Write LocalFaultCode [29], Kernel Mode:
Read it back [29]:
Write LocalFaultCode [29], ByteWrite:
Read it back [29]:

Write LocalFaultCode [29], User Mode: Should generate protection fault
SmallCacheInner-Misc:
Do a CWS[adrs=20, oldVal=CC, newVal=DD].  The current value of location 20 is CC, so the CWS should succeed.  The CWS will be local since shared is not set.
Write CWSOld [01]:
Write CWSOld [03]:

Initiate CWS [20, CC, DD]:
Read location 20 to make sure that it got written
Now do a CWS[adrs=20, oldVal=CC, newVal=DD].  The current value of location 20 is DD, so the CWS should fail.
Initiate CWS [20, CC, DD]:
Read location 20 to make sure that it didn't get written
Next do a DeMap (Memory|Special|Write) to a page that has one entry in the cache
Initiate DeMap(Adrs=RA, Data=Don'tCare):
Here's the Demap request on our input wires, followed by the DeMapRply
Finally do a DeMap (Memory|Special|Write) to a page that has multiple entries in the cache
Initiate DeMap(Adrs=RA, Data=Don'tCare):
Here's the Demap request on our input wires, followed by the DeMapRply
SmallCacheInner-ClrAllVPV:
Do a ClearAllVPV (Memory|Special|Write)
Initiate ClearAllVPV(Adrs=Don'tCare, Data=Don'tCare):
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